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FPGA开发笔记
使用环境:Windows10 Quartus Prime 17.1 Lite Testbench仿真 1.打开编译功能网表后编译工程 2.新建verilog文件,编写Testbench文件,注意module名与文件名相同。可使用Quartus生成的Testbench模板 3.配置工程仿真选项,选择仿真程序为modelsim-altera,新建Tes…